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用Allegro画PCB的人，十个里面有八个被差分线对和等长设置折磨过。我自己2024年做一个高速板的时候，光等长调线就花了3天，后来才发现是方法不对。2026年Allegro更新到17.x版本之后，操作逻辑变了不少，但核心流程没变。下面这5个操作技巧，是我踩了无数坑之后总结出来的，每一个都能帮你省至少2小时。
差分线对设置是高速PCB设计的基本功，但很多人不知道在哪里改。
打开Allegro PCB Editor，菜单栏找到Electrical → Differential Pair。点进去之后会弹出一个设置窗口，你可以新建差分对规则，也可以直接用默认设置。
我的建议是新建，别用默认。默认规则的间距和阻抗参数不一定匹配你的板层结构。新建的时候，差分阻抗填100Ω，间距根据你的线宽线距来算，比如5mil线宽、5mil间距，差分阻抗大概在90Ω到110Ω之间。
设置完电气规则之后，别忘了切到Physical → Net → All Layers。这一步很多人跳过了，结果电气规则设了但物理层没同步，DRC跑出来一堆错误。切到All Layers之后，所有层的差分对都会按照你刚才设的规则自动调整，实时就能看到效果。
我之前有个项目，4对差分线，用默认规则跑完DRC报了17个错误，全是差分间距不对。后来手动建了规则，切到All Layers同步了一遍，错误直接清零。就这一个操作，省了我半天调线时间。
等长调线是让人最头疼的环节，特别是数据线组，一调就是几十根。
Allegro里做等长，核心命令是relative propagation。在约束管理器里找到这个选项，选中之后，右键点击操作信号，选择Create → Match Group。
这里有个关键细节：添加进match group的信号必须包含数据线、时钟线和有效信号。比如一个RXD信号组，你要把RXD_0到RXD_3、RXD_CLK、RXD_DV全部加进去，并且指定RXD_CLK作为target。
为什么要指定target？因为等长调线是以某一根线为基准，其他线向它对齐。时钟线通常是最关键的，所以拿它当基准最合理。我做过一个DDR4的项目，数据线16根，时钟线2根，全部用match group归到一组，指定CLK为target，一次就把等长调完了。
如果你不用match group，一根一根手动调，16根线至少要调2小时。用了match group，5分钟搞定。这个差距不是夸张，是我实测的数据。
还有一点：match group里的线必须在同一个网络类里，不然relative propagation识别不了。建网络类的时候把相关信号全部放进去，别漏。
这两个操作单独拿出来说，因为太多人不知道了。
过孔矩阵怎么放？
菜单栏选Place → Via Arrays → Matrix。弹出窗口后，先选网络，再设过孔间距，然后框选你要放置的范围，点击焊盘位置就放好了。
过孔间距一般设成20mil到30mil，太密了焊接的时候容易连锡，太疏了散热不够。我做电源层过孔矩阵的时候，间距设的25mil，阵列大小4×4，一块板子放了12组，散热效果比单过孔好了不止一倍。
多个元器件怎么同时旋转？
这个操作90%的人不知道。场景是这样的：你有5个电阻要围绕同一个点旋转，不是各自转各自的，是整体转。
操作步骤：Edit → Move，在Options里把Rotation的Point改成User Pick。然后右键选Term Group，按住鼠标左键拉框选中所有要旋转的器件，多选了的按Ctrl+左键点掉。选完之后右键Complete，再Pick origin选旋转中心，最后右键选Rotate就行了。
我之前调一个BGA扇出，12个电阻要围绕BGA中心点旋转对齐，一个一个转花了40分钟。后来用这个方法，30秒搞定。
画板框outline的时候，经常碰到一个问题：想画直角，结果画出来是斜边。
这个问题分两种情况。
如果你画的是line属性：点Edit → Vertex，选中那条斜边，直接输入顶点坐标，比如x 123 y 321，回车，直角就出来了。
如果是shape属性：点Shape → Edit Boundary，同样选中斜边，输入坐标值确认。
核心就是一个动作：手动输入顶点坐标，覆盖掉软件自动生成的斜边。我画了上百块板子，这个问题每次都碰得到，特别是板框尺寸不规则的时候，软件自动生成的角度经常偏个几度，看着难受。
有个小技巧：画板框之前先把栅格设成1mil，这样顶点坐标更精确，画出来的直角就是真正的90度，不会有偏差。
这5个操作覆盖了Allegro日常画板80%的高频场景。差分线对、等长调线、过孔矩阵、批量旋转、outline修正，每一个都是我实际项目里反复用过的。你现在手上有Allegro工程在跑吗？打开约束管理器，把match group先建起来，等长调线的效率能翻3倍。
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